《 Verilog-Based錯誤注入訊號的自動化產生工具》碩士論文下載 | 博碩士論文下載網
- 論文名稱:Verilog-Based錯誤注入訊號的自動化產生工具
- 論文名稱(外文):A Workbench for Automatic Generation of Verilog-based Fault Signal Injection
- 學校名稱:國立中山大學
- 系所名稱:資訊工程學系研究所
- 畢業學年度:107
- 學位類別:碩士
- 作者:盧弦林
- 指導教授:黃英哲
- 碩士論文下載網址:https://hdl.handle.net/11296/976b9r
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